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  • DDR SDRAM控制器数据通道的设计与实现

    1f 仿真工具进行了功能仿真;用quartusⅱ7.1 软件进行综合、 时序分析、布局布线;用modelsim 进行后仿真,仿真结果正确。选用cyclone iii fpga starter kit 开发板对本文提出的电路进行调试。调试结果显示,本文提出的电路可以稳定工作,设 计满足jesd79e 标准的要求,可以用于实际应用中。 altera 公司在文献[3]中提供了一个数据通道的参考设计,并将此参考设计与本文提出的 电路用quartusⅱ软件进行综合。选用cyclone iii 系列的ep3c25f324c6 器件作为应用器 件。表2 给出了综合报告表,其中altera data-path 为altera 公司的参考设计电路,my data-path 为本文提出的电路。从表2 可以看出,本文提出的电路比altera 公司给出的参考设计电路在 面积上不占优势,但在速度方面优势明显。 6 结束语 本文根据 jesd79e 标准的描述,对存储器控制器进行了模块划分,找出与控制器数据 通道相关的操作,然后以时钟为坐标,建立信号的时序模型,列出读写时序方程,最后按照 时序和电路特性的要求设

ep3c25f324c6替代型号

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EP3C25F324C8 EP3C25Q240C8 EP3C25Q240C8N EP3C40F484C8 EP3C40Q240C8 EP3C40Q240C8N EP3C5E144C8 EP3CLS200F780C7N EP3SE110F1152C4 EP3SL150F1152C2

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